Metodología para el diseño de circuitos asincronos pseudo-insensibles a retardos
- Autores: Antonio Óscar Garnica Alcazar
- Directores de la Tesis: Juan Lanchares Dávila (dir. tes.), Juan Manuel Sánchez Pérez (codir. tes.)
- Lectura: En la Universidad Complutense de Madrid ( España ) en 2001
- Idioma: español
- Tribunal Calificador de la Tesis: Román Hermida Correa (presid.), María Milagros Fernández Centeno (secret.), Juan Carlos López López (voc.), Luis Entrena (voc.), Antonio Acosta (voc.)
- Materias:
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- Resumen
El objetivo de esta tesis es proporcionar una metodologia para el diseño de circuitos asíncronos de altas prestaciones y bajo consumo que permita el empleo de herramientas de diseño de circuitos sincronos.
Para conseguir este objetivo ha sido necesario, en primer lugar, encontrar la estructura del circuito que permite alcanzar los rendimientos deseados y reducir los requisitos de area. En segundo lugar, hemos definido el protocolo de comunicación que sincroniza de forma correcta los distintos componentes del circuito y el circuito con su entorno. A continuacion hemos estudiado el rendimiento de los circuitos construidos con la estructura y el protocolo definidos con anterioridad. Posteriormente, hemos desarrollado una metodologia de diseño que con la que es posible la construccion de circuitos asincronos utilizando el flujo de diseño, las herramientas y las bibliotecas de celdas empleadas en el diseño sincrono. Finalmente, y como ultima aportacion, hemos definido un modelo del comportamiento temporal, de los componentes del circuito que reduce las necesidades del area y consumo de potencia de los circuitos asincronos.
