Arquitecturas para la transformada rapida coseno
- Autores: Manuel Sanchez Lopez
- Directores de la Tesis: Emilio López Zapata (dir. tes.)
- Lectura: En la Universidad de Málaga ( España ) en 1998
- Idioma: español
- Tribunal Calificador de la Tesis: Alfonso Gago Bohorquez (presid.), María Inmaculada García Fernández (secret.), José Ignacio Benavides Benítez (voc.), Ramón Ruiz Merino (voc.), Javier Díaz Bruguera (voc.)
- Materias:
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- Resumen
En el campo de las tecnologías multimedia, la compresión de imágenes juega un papel fundamental. Todos los estándares actuales integran a la transformada discreta coseno (DCT) como uno de los métodos a aplicar en este trabajo se desarrollan arquitecturas específicas para la realización VLSI de la DCT basada en un algoritmo rápido (FCT).
Se proponen, tanto implementaciones basadas en aritmética bit serie y replicación de unidades funcionales, así como, realizaciones que utilizan aritmética bit paralelo sin explotación de paralelismo espacial. Se han llevado a cabo ejemplos de implementación de las mismas usando librerías de celdas estándar. Además, se estudia la posibilidad de arquitecturas multiprocesadoras bit paralelo libres de conflictos de acceso a memoria.
