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Redes de interconexión de procesadores con capacidad de tolerancia a fallos

  • Autores: Santiago Sánchez Solano, Manuel Valencia Barrero, José Luis Huertas Díaz, Carlos Jesús Jiménez Fernández
  • Localización: VII Congreso de Diseño de Circuitos Integrados: 3, 4 y 5 de noviembre de 1992, Toledo, España : actas, 1992, págs. 541-542
  • Idioma: español
  • Texto completo no disponible (Saber más ...)
  • Resumen
    • Se describe una familia de redes de interconexión para sistemas multiprocesadores. Estas redes utilizan buses múltiples estructurados en varios niveles e incorporan el concepto de tolerancia a fallos mediante redundancia en las vías de comunicación. Sus principales características son: buena relación coste/rendimiento, fiabilidad, modularidad y flexibilidad. La comunicación incluye asimismo una visión panorámica de los aspectos de diseño e implementación de una serie de prototipos de los elementos básicos de la red de interconexión


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